信號電平簡述

信號質量涉及到的幾個概念

波形周期：對于重復性的波形，相鄰兩個重復波形間的間隔時間，定義為波形周期，其倒數(shù)為波形頻率。

波形寬度：波形電壓上升到波形幅度的50%起到波形電壓下降到波形幅度的50%止的時間。

上升時間：波形電壓從波形幅度的10%上升到90%所需要的時間。

下降時間：波形電壓從波形幅度的90%下降到10%所需要的時間。

占空比：指波形寬度占周期的比例，例如方波的占空比為50%。

高電平：為一個閥值，當信號電平超過此值時，會被認為為高，也就是‘1’，在應用中，有輸入輸出之分。

低電平：為一個閥值，當信號電平低過此值時，會被認為為低，也就是‘0’，在應用中也有輸入輸出之分。

輸入高電平（VIH ）：保證邏輯門的輸入為高電平時所允許的小輸入高電平，當輸入電平 高于 VIH時，則認為輸入電平為高電平。

輸入低電平 （VIL ）：保證邏輯門的輸入為低電平時所允許的大輸入低電平，當輸入電平 低于 VIL時，則認為輸入電平為低電平。

輸出高電平 （VOH）：保證邏輯門的輸出為高電平時的輸出電平的小值，邏輯門的輸出為 高電平時的電平值都必須大于此 VOH。

輸出低電平 （VOL）：保證邏輯門的輸出為低電平時的輸出電平的大值，邏輯門的輸出為 低電平時的電平值都必須小于此 VOL。

閥值電平 （VT）：數(shù)字電路芯片都存在一個閾值電平，就是電路剛剛勉強能翻轉作時的 電平。 它是一個界于 VIL、VIH之間的電壓值。 對于 CMOS電路的閾值電平，基本上是二分之一的電源電壓值。但要保證穩(wěn)定的輸出，則必 須要求輸入高電平 >VIH ，輸入低電平 <VIL，而如果輸入電平在閾值 上下，也就是 VIL～VIH這個區(qū)域，電路的輸出會處于不穩(wěn)定狀態(tài)。

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②PI電源完整性測試，主要內容是電源的電壓值（精度）、電源噪聲/紋波、電壓上下波形、測量緩啟動電路參數(shù)、電源電流和沖擊電流、電源告警信號、冗余電源的均流參數(shù)。

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